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Design and implementation of cascade decimation filter for radio communications

  • University of Carthage, Ecole Supérieure des Communications de Tunis

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Résumé

This paper describes the design of a decimation filter for use with a 4th order bandpass ΣΔ modulator adapted for multi-standards wireless transceiver. The simulations undertaken demonstrated that GSM and DECT standards specifications are met by a filtering cascade structure composed of 5th order comb filter, 2 half-band filter stages and a droop-correction filter. A fixed-point architectural design was defined and low-power FPGA implementation results are reported.

langue originaleAnglais
titreICECS 2001 - 8th IEEE International Conference on Electronics, Circuits and Systems
Pages1603-1606
Nombre de pages4
étatPublié - 1 déc. 2001
Evénement8th IEEE International Conference on Electronics, Circuits and Systems, ICECS 2001 - , Malte
Durée: 2 sept. 20015 sept. 2001

Série de publications

NomProceedings of the IEEE International Conference on Electronics, Circuits, and Systems
Volume3

Une conférence

Une conférence8th IEEE International Conference on Electronics, Circuits and Systems, ICECS 2001
Pays/TerritoireMalte
période2/09/015/09/01

Empreinte digitale

Examiner les sujets de recherche de « Design and implementation of cascade decimation filter for radio communications ». Ensemble, ils forment une empreinte digitale unique.

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