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Level matrix propagation for reliability analysis of nano-scale circuits based on probabilistic transfer matrix

  • CNRS LTCI
  • UFE - Université Française d'Egypte

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3 Citations (Scopus)

Résumé

As CMOS technology is reaching the nanometer scale, transient and intermittent faults occurrence in logic circuits, which implies a reliability degradation, can no longer be neglected. This paper deals with reliability evaluation which is a critical parameter in circuit design. The proposed method is scalable, iterative and accelerates the reliability analysis.

langue originaleAnglais
titreProceedings of the 11th International Symposium on Quality Electronic Design, ISQED 2010
Pages524-527
Nombre de pages4
Les DOIs
étatPublié - 28 mai 2010
Modification externeOui
Evénement11th International Symposium on Quality Electronic Design, ISQED 2010 - San Jose, CA, États-Unis
Durée: 22 mars 201024 mars 2010

Série de publications

NomProceedings of the 11th International Symposium on Quality Electronic Design, ISQED 2010

Une conférence

Une conférence11th International Symposium on Quality Electronic Design, ISQED 2010
Pays/TerritoireÉtats-Unis
La villeSan Jose, CA
période22/03/1024/03/10

Empreinte digitale

Examiner les sujets de recherche de « Level matrix propagation for reliability analysis of nano-scale circuits based on probabilistic transfer matrix ». Ensemble, ils forment une empreinte digitale unique.

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