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Test sequence generation from formally verified sysml models

  • Université de Toulouse
  • Université Paris-Saclay

Résultats de recherche: Contribution à un journalArticle de conférenceRevue par des pairs

Résumé

Test generation has been acknowledged as a costprone activity reducing productivity and time to market. The expected benefits of Model Based Systems Engineering include automated generation of test sequences from models. The paper proposes verification solutions for the System Modeling Language (SysML). In particular, the paper shows how to link test generation to formal verification. The proposed algorithms are implemented by the free software TTool. Two case studies support discussion on conformance and interoperability testing, respectively.

langue originaleAnglais
Pages (de - à)67-74
Nombre de pages8
journalCEUR Workshop Proceedings
Volume2308
étatPublié - 1 janv. 2019
Modification externeOui
Evénement2019 Workshops of the Software Engineering Conference, SEW 2019 - Stuttgart, Allemagne
Durée: 18 févr. 201922 févr. 2019

Empreinte digitale

Examiner les sujets de recherche de « Test sequence generation from formally verified sysml models ». Ensemble, ils forment une empreinte digitale unique.

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